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【2h】

VHDL to FPGA automatic IP-Core generation: a case study on Xilinx design flow

机译：从VHDL到FPGA的自动IP核生成：以Xilinx设计流程为例

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作者
F. FERRANDI; FERRARA G; PALAZZO R; RANA V; SANTAMBROGIO M.D;
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年度 2006
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